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Parfois, une surprise tombe du ciel sur vos genoux… et récemment, nous avons parlé du travail en cours sur le Neo Geo CD core pour MiSTer. FPGA. Et MAINTENANT, les fonctionnalités du noyau Neo Geo CD ont été intégrées au noyau Neo Geo AES / Neo Geo MVS sur MiSTer. FPGA pour vous donner tous les éléments du matériel d’arcade et de console de salon Neo Geo… en un seul et même endroit. FPGA core ! Avec le support Neo Geo CDZ, le support Neo Geo Unibios…et le support CD à chargement rapide !
Sachez qu’il y a maintenant un dossier NEO GEO CD dans lequel vous pouvez mettre vos jeux. Ce n’est pas nécessaire…vous pouvez naviguer vers votre dossier Neo Geo CD dans le dossier Neo Geo AES/MVS games…mais vous n’êtes pas obligé !
Update_all apportera le nouveau core ainsi que les fichiers bios corrects si vous avez activé BIOS GETTER aussi !
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tobemorecrazy, Mike Puelinckx, Tony Escobar, H7, Humanoide70, Ben Parfitt, Holder Schmidt, Tim Lehner, Shad Uttam, Dan L, James Mann, Richard Schneider, Coupon Joe, Sunder Raj, Dorfus the Maple Syrup Man, John Booty et Craig M !
J’ai demandé, vous avez répondu… et j’essaie d’écouter 🙂 Parmi toutes les demandes de nouveaux contenus sur la chaîne, l’une des vidéos les plus fréquemment demandées est une série sur le Terasic DE-10 Nano MiSTer. FPGA …alors la voici ! Du rétro gaming à revendre.
Dans cet épisode de notre série MiSTer, nous allons parler de la récente version du Neo Geo Core ! Il fonctionne sur les MiSTer Main builds maintenant et arrive avec update_all… et jusqu’à présent, il est très impressionnant et peut-être la meilleure nouvelle façon de jouer aux jeux Neo Geo ! Mais le Neo Geo CD a tellement de hits rétrogaming et quelques exclusivités solides comme Puzzle Bobble, Ironclad et Crossed Swords II… ainsi que beaucoup de hits Neo Geo AES et MVS comme Fatal Fury, the King of Fighters, Pulstar, etc etc.
Ajoutez à cela la bibliothèque complète des meilleurs jeux Neo Geo AES et des joyaux cachés Neo Geo et vous obtenez l’un des noyaux les plus impressionnants du MiSTer. FPGA! Le Neo Geo a l’impression d’être fini !
J’ai hâte de voir si ce noyau sera développé !
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youyeetoo Sipeed Tang Primer 25K Dock FPGA Development Board MCU, RISCV, Modularisation, Gowin GW5A, PMOD SDRAM, 23K LUT4, MIPI 2.5Gbps (25K Pmod + SDRAM)La carte d'accueil Tang Primer 25K est une nouvelle génération de cartes d'accueil modulaires, équipée d'un débogueur USB JTAG, de 3 interfaces PMOD et d'une interface d'en-tête à broches 40P. Il contient Gowin GW5A-LV25MG121, 64 Mbit SPI FLASH, alimentation DC-DC. La carte SoM offre 76 GPIOs, 1 Hardcore 4lane MIPI D-PHY et 3 sorties d'alimentation. Si vous alimentez le SOM en 5V et que vous configurez correctement, vous pouvez facilement utiliser le SOM. [WIKI] https://wiki.sipeed.com/primer25k -
iFutniew Carte de Développement Tang Nano 20K FPGA RISCV Linux pour Joueur de RétroLa puce BL616 intégrée de téléchargeur FPGA JTAG et de port série pour la communication avec le FPGA. Tang Nano 20K est une carte mère utilisant GOWIN Semiconductor GW2AR-18 QN88. La puce possède 20 736 tables de recherche logique (LUT4) et 15 552 registres (FF). Il y a deux PLL à l'intérieur et plusieurs unités . Prend en charge la multiplication 18 bits x 18 bits pour accélérer les opérations numériques. La carte utilise par défaut un oscillateur à cristal de 27 MHz pour multiplier l'horloge requise pour l'affichage compatible , et est également équipée d'une puce de génération d'horloge MS5351 pour générer une variété d'horloges requises à volonté. Il est doté d'une SDRAM intégrée de 64 Mbits à faible latence, qui facilite l'exécution de l'émulateur et facilite l'exécution des systèmes Linux soft-core. La puce de téléchargement intégrée a été mise à niveau vers une interface USB2.0 , avec les fonctions de téléchargement JTAG haute vitesse, de communication série, de réception SPI haute vitesse et de configuration précise de l'horloge. -
Remingtape Pour carte mère Mister FPGA 128 Mo V2.9 + hub USB V2.1 avec kit de boîtier en métal DIY pour Terasic DE10-Nano Mister FPGA (argent)Port CC 5 V. Avec cette carte, le MiSTer dispose d'un port USB supplémentaire qui s'adapte exactement sous le boîtier existant. Le pont USB se connecte parfaitement nano SoC DE10 sans câbles supplémentaires. Pour carte de hub USB Mister-: il s'agit d'un hub USB supplémentaire en option pour des connexions pratiques de périphériques USB. Port micro USB en amont Basé sur la puce FE2.1 -
Lichee Tang Nano Minimaliste FPGA Planche d'expérimentation en ligne 2020 (Tang Nano + écran 4,3")La carte FPGA Seeed Studio Sipeed Tang Nano est alimentée par un GW1N-1 FPGA et porte une puce de noyau GW1N-1-LV de faible puissance. La puce GW1N-1-LV offre le 1152 LUT4 qui contient 4 adresses pour RAM et 864 FF (Flip-Flop). La carte nano Tang a une petite taille compacte et un module DSP n'est pas inclus. Puce FPGA GWIN-1-LV: LUT4 1152, Flip-Flop 864, BSRAM (bits) 72K, flash utilisateur (bits) 96K, PLLs+DLLs 1+0, tension centrale 1,2 V Capacité de la puce PSRAM intégrée : 64 Mbits à 3,3 V, alimentation et interface de téléchargement : interface USB-C Oscillateur à cristal intégré de 24 MHz (démarré par CH552, tension d'alimentation externe de 5,0 V ± 0,2 V Tang nano wiki:tangnano.sipeed.com, Tang nanoDownload PDF:http://cn.dl.sipeed.com/TANG/Nano
